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发表于《几片单通道ADC，用同样的时钟，采样就能保证同步了吗？》
duweitao
12年8个月前IP:未同步
684990
3楼
不知道理解的对不对，之前遇到的方案都是，晶振出的时钟，进入时钟管理芯片（或电路），然后分配出多路的时钟信号，该信号直接送给ADC。
高速的ADC通常会有随着数据出来的同步时钟信号。
高速高质量数据采集的情况下，通常ADC的采样时钟不会经过FPGA，因为其相位性能不好。
这里有个框图可以看看
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我也是有底线的