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发表于《【原创】【持续更新】100MHz带宽500MSPS采样率的USB虚拟示波器原理图和PCB》
ddomax作者
13年4个月前IP:未同步
560089
20楼
回 19楼(神之觉醒) 的帖子
不行啊。FPGA内部一个buffer延时就要1ns多，走线延时也不好控制，也是ns级的，最最主要的是这货产生的延迟，随电压温度大幅度动荡。所以才有加电压，OC嘛！
其实用xilinx的FPGA能解决，因为它集成了DCM，延迟线。不过Xlinx太贵了，而且我不会用。
PLL级联产生的相移分辨率够了，不过jitter有300ps，又要外加去抖芯片。
https://www.kechuang.org/t/59331
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文号 / 560089
ddomax
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我也是有底线的